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Dissertations / Theses on the topic 'Rekonfigurierbar'

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Heinzig, André. "Entwicklung und Herstellung rekonfigurierbarer Nanodraht-Transistoren und Schaltungen." Doctoral thesis, Saechsische Landesbibliothek- Staats- und Universitaetsbibliothek Dresden, 2016. http://nbn-resolving.de/urn:nbn:de:bsz:14-qucosa-202082.

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Abstract:
Die enorme Steigerung der Leistungsfähigkeit integrierter Schaltkreise wird seit über 50 Jahren im Wesentlichen durch eine Verkleinerung der Bauelementdimensionen erzielt. Aufgrund des Erreichens physikalischer Grenzen kann dieser Trend, unabhängig von der Lösung technologischer Probleme, langfristig nicht fortgesetzt werden. Diese Arbeit beschäftigt sich mit der Entwicklung und Herstellung neuartiger Transistoren und Schaltungen, welche im Vergleich zu konventionellen Bauelementen funktionserweitert sind, wodurch ein zur Skalierung alternativer Ansatz vorgestellt wird. Ausgehend von gewachsenen und nominell undotierten Silizium-Nanodrähten wird die Herstellung von Schottky-Barrieren-Feldeffekttransistoren (SBFETs) mit Hilfe etablierter und selbst entwickelter Methoden beschrieben und die Ladungsträgerinjektion unter dem Einfluss elektrischer Felder an den dabei erzeugten abrupten Metall–Halbleiter-Grenzflächen analysiert. Zur Optimierung der Injektionsvorgänge dienen strukturelle Modifikationen, welche zu erhöhten ambipolaren Strömen und einer vernachlässigbaren Hysterese der SBFETs führen. Mit dem rekonfigurierbaren Feldeffekttransistor (RFET) konnte ein Bauelement erzeugt werden, bei dem sich Elektronen- und Löcherinjektion unabhängig und bis zu neun Größenordnungen modulieren lassen. Getrennte Topgate-Elektroden über den Schottkybarrieren ermöglichen dabei die reversible Konfiguration von unipolarer Elektronenleitung (n-Typ) zu Löcherleitung (p-Typ) durch eine Programmierspannung, wodurch die Funktionen konventioneller FETs in einem universellen Bauelement vereint werden. Messungen und 3D-FEM-Simulationen geben einen detaillierten Einblick in den elektrischen Transport und dienen der anschaulichen Beschreibung der Funktionsweise. Systematische Untersuchungen zu Änderungen im Transistoraufbau, den Abmessungen und der Materialzusammensetzung verdeutlichen, dass zusätzliche Strukturverkleinerungen sowie die Verwendung von Halbleitern mit niedrigem Bandabstand die elektrische Charakteristik dieser Transistoren weiter verbessern. Im Hinblick auf die Realisierung neuartiger Schaltungen wird ein Konzept beschrieben, die funktionserweiterten Transistoren in einer energieeffizienten Komplementärtechnologie (CMOS) nutzbar zu machen. Die dafür notwendigen gleichen Elektronen- und Löcherstromdichten konnten durch einen modifizierten Ladungsträgertunnelprozess infolge mechanischer Verspannungen an den Schottkyübergängen erzielt und weltweit erstmalig an einem Transistor gezeigt werden. Der aus einem <110>-Nanodraht mit 12 nm Si-Kerndurchmesser erzeugte elektrisch symmetrische RFET weist dabei eine bisher einzigartige Kennliniensymmetrie auf.Die technische Umsetzung des Schaltungskonzepts erfolgt durch die Integration zweier RFETs innerhalb eines Nanodrahts zum dotierstofffreien CMOS-Inverter, der flexibel programmiert werden kann. Die rekonfigurierbare NAND/NOR- Schaltung verdeutlicht, dass durch die RFET-Technologie die Bauelementanzahl reduziert und die Funktionalität des Systems im Vergleich zu herkömmlichen Schaltungen erhöht werden kann. Ferner werden weitere Schaltungsbeispiele sowie die technologischen Herausforderungen einer industriellen Umsetzung des Konzeptes diskutiert. Mit der funktionserweiterten, dotierstofffreien RFET-Technologie wird ein neuartiger Ansatz beschrieben, den technischen Fortschritt der Elektronik nach dem erwarteten Ende der klassischen Skalierung zu ermöglichen
The enormous increase in performance of integrated circuits has been driven for more than 50 years, mainly by reducing the device dimensions. This trend cannot continue in the long term due to physical limits being reached. The scope of this thesis is the development and fabrication of novel kinds of transistors and circuits that provide higher functionality compared to the classical devices, thus introducing an alternative approach to scaling. The fabrication of Schottky barrier field effect transistors (SBFETs) based on nominally undoped grown silicon nanowires using established and developed techniques is described. Further the charge carrier injection in the fabricated metal to semiconductor interfaces is analyzed under the influence of electrical fields. Structural modifications are used to optimize the charge injection resulting in increased ambipolar currents and negligible hysteresis of the SBFETs. Moreover, a device has been developed called the reconfigurable field-effect transistor (RFET), in which the electron and hole injection can be independently controlled by up to nine orders of magnitude. This device can be reversibly configured from unipolar electron conducting (ntype) to hole conducting (p-type) by the application of a program voltage to the two individual top gate electrodes at the Schottky junctions. So the RFET merges the functionality of classical FETs into one universal device. Measurements and 3D finite element method simulations are used to analyze the electrical transport and to describe the operation principle. Systematic investigations of changes in the device structure, dimensions and material composition show enhanced characteristics in scaled and low bandgap semiconductor RFET devices. For the realization of novel circuits, a concept is described to use the enhanced functionality of the transistors in order to realize energy efficient complementary circuits (CMOS). The required equal electron and hole current densities are achieved by the modification of charge carrier tunneling due to mechanical stress and are shown for the first time ever on a transistor. An electrically symmetric RFET based on a compressive strained nanowire in <110> crystal direction and 12 nm silicon core diameter exhibits unique electrical symmetry. The circuit concept is demonstrated by the integration of two RFETs on a single nanowire, thus realizing a dopant free CMOS inverter which can be programmed flexibly. The reconfigurable NAND/NOR shows that the RFET technology can lead to a reduction of the transistor count and can increase the system functionality. Additionally, further circuit examples and the challenges of an industrial implementation of the concept are discussed.The enhanced functionality and dopant free RFET technology describes a novel approach to maintain the technological progress in electronics after the expected end of classical device scaling
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Ishebabi, Harold. "Architecture synthesis for adaptive multiprocessor systems on chip." Phd thesis, Universität Potsdam, 2010. http://opus.kobv.de/ubp/volltexte/2010/4131/.

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Abstract:
This thesis presents methods for automated synthesis of flexible chip multiprocessor systems from parallel programs targeted at FPGAs to exploit both task-level parallelism and architecture customization. Automated synthesis is necessitated by the complexity of the design space. A detailed description of the design space is provided in order to determine which parameters should be modeled to facilitate automated synthesis by optimizing a cost function, the emphasis being placed on inclusive modeling of parameters from application, architectural and physical subspaces, as well as their joint coverage in order to avoid pre-constraining the design space. Given a parallel program and a set of an IP library, the automated synthesis problem is to simultaneously (i) select processors (ii) map and schedule tasks to them, and (iii) select one or several networks for inter-task communications such that design constraints and optimization objectives are met. The research objective in this thesis is to find a suitable model for automated synthesis, and to evaluate methods of using the model for architectural optimizations. Our contributions are a holistic approach for the design of such systems, corresponding models to facilitate automated synthesis, evaluation of optimization methods using state of the art integer linear and answer set programming, as well as the development of synthesis heuristics to solve runtime challenges.
Aktuelle Technologien erlauben es komplexe Multiprozessorsysteme auf einem Chip mit Milliarden von Transistoren zu realisieren. Der Entwurf solcher Systeme ist jedoch zeitaufwendig und schwierig. Diese Arbeit befasst sich mit der Frage, wie On-Chip Multiprozessorsysteme ausgehend von parallelen Programmen automatisch synthetisiert werden können. Die Implementierung der Multiprozessorsysteme auf rekonfigurierbaren Chips erlaubt es die gesamte Architektur an die Struktur eines vorliegenden parallelen Programms anzupassen. Auf diese Weise ist es möglich die aktuellen technologischen Unzulänglichkeiten zu umgehen, insbesondere die nicht weitersteigende Taktfrequenzen sowie den langsamen Zugriff auf Datenspeicher. Eine Automatisierung des Entwurfs von Multiprozessorsystemen ist notwendig, da der Entwurfsraum von Multiprozessorsystemen zu groß ist, um vom Menschen überschaut zu werden. In einem ersten Ansatz wurde das Syntheseproblem mittels linearer Gleichungen modelliert, die dann durch lineare Programmierungswerkzeuge gelöst werden können. Ausgehend von diesem Ansatz wurde untersucht, wie die typischerweise langen Rechenzeiten solcher Optimierungsmethoden durch neuere Methode aus dem Gebiet der Erfüllbarkeitsprobleme der Aussagenlogik minimiert werden können. Dabei wurde die Werkzeugskette Potassco verwendet, in der lineare Programme direkt in Logikprogramme übersetzt werden können. Es wurde gezeigt, dass dieser zweite Ansatz die Optimierungszeit um bis zu drei Größenordnungen beschleunigt. Allerdings lassen sich große Syntheseprobleme auf diese weise wegen Speicherbegrenzungen nicht lösen. Ein weiterer Ansatz zur schnellen automatischen Synthese bietet die Verwendung von Heuristiken. Es wurden im Rahmen diese Arbeit drei Heuristiken entwickelt, die die Struktur des vorliegenden Syntheseproblems ausnutzen, um die Optimierungszeit zu minimieren. Diese Heuristiken wurden unter Berücksichtigung theoretischer Ergebnisse entwickelt, deren Ursprung in der mathematische Struktur des Syntheseproblems liegt. Dadurch lassen sich optimale Architekturen in kurzer Zeit ermitteln. Die durch diese Dissertation offen gewordene Forschungsarbeiten sind u. a. die Berücksichtigung der zeitlichen Reihenfolge des Datenaustauschs zwischen parallelen Tasks, die Optimierung des logik-basierten Ansatzes, die Integration von Prozessor- und Netzwerksimulatoren zur funktionalen Verifikation synthetisierter Architekturen, sowie die Entwicklung geeigneter Architekturkomponenten.
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Ihmor, Stefan, and Marcel Flade. "Rekonfigurierbare Schnittstellen." Universitätsbibliothek Chemnitz, 2006. http://nbn-resolving.de/urn:nbn:de:swb:ch1-200600261.

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Abstract:
Die neu ins Leben gerufene Schriftenreihe EINGEBETTETE, SELBSTORGANISIERENDE SYSTEME (ESS) widmet sich einer sehr aktuellen Thematik der Technischen Informatik. Seit Jahren durchdringen eingebettete Systeme unseren Alltag in fast allen Lebensbereichen. Angefangen von automatisierten Türöffnungssystemen, über komplex gesteuerte Servicemaschinen, z.B. Waschmaschinen, bis hin zu mobilen, persönlich zugeordneten Systemen wie Mobiltelefone und Handheld-Computer sind eingebettete Systeme zur Selbstverständlichkeit geworden. Der Aspekt der rekonfigurierbaren Schnittstellen zwischen einzelnen Komponenten eingebetteter Systeme wird in diesem ersten Band aufgegriffen. Der erste Beitrag befasst sich mit der systematischen Modellierung von Schnittstellen. Zunächst werden aktive Tasks und Kommunikationsmedien unterschieden sowie die Parameter der Zielarchitektur in den Entwurfsprozess für Schnittstellen eingebracht. Darauf aufbauend wird eine systematische Konzeption von Schnittstellen vorgestellt und bewertet. Der zweite Beitrag betrachtet das Problem der Rekonfigurierung von Schnittstellen zur Gewährleistung von sicherer Funktionalität, auch im Fehlerfall. Die Fehlererkennung und –behandlung werden von der erweiterten Schnittstelle implementiert. In dem dritten Beitrag untersucht Marcel Flade Schnittstellen in Hardware/Software-Systemen. Dabei stellt sich das Problem, die Kontrolle über die Funktionalität der Schnittstelle auf den Software- und Hardwareteil aufzuteilen. Die Beiträge werden durch eine vollständige Implementierung eines Beispiels und eines Werkzeugs zur automatisierten Generierung der VHDL-Implementierung abgerundet. Mit diesen ausgewählten Arbeiten, die in den ersten Band dieser wissenschaftlichen Schriftenreihe aufgenommen sind, werden dem Leser grundlegende Aspekte rekonfigurierbarer Schnittstellen für eingebettete, selbstorganisierende Systeme vorgestellt.
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Richly, Sebastian. "Autonom rekonfigurierbare Workflows." Doctoral thesis, Saechsische Landesbibliothek- Staats- und Universitaetsbibliothek Dresden, 2012. http://nbn-resolving.de/urn:nbn:de:bsz:14-qucosa-88814.

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Abstract:
Prozesse, seien es Geschäfts- oder Produktionsprozesse, sind ständigen Änderungen unterworfen. Für Unternehmen gilt es, sich im Rahmen von Geschäftsprozessen immer wieder neuen Marktgegebenheiten, Gesetzen oder Kunden anzupassen. Auch Produktionsprozesse müssen bspw. für die Verarbeitung neuer Materialien zugeschnitten werden. Die vorliegende Arbeit beschreibt deshalb, einen umfassenden Ansatz für den Umgang mit Änderungen bzw. Rekonfigurationen von Workflows zu entwickeln. Dieser zeichnet sich durch zwei Schwerpunkte aus: (1) Vollständige Rekonfiguration aller Workflowperspektiven und (2) eine reflexive autonome Steuerung der Rekonfigurationen.
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Köhler, Stefan, Jan Schirok, and Rainer G. Spallek. "Rekonfigurierbare DSP-Datenpfaderweiterungen für energieeffiziente, eingebettete Prozessorkerne." Universitätsbibliothek Chemnitz, 2007. http://nbn-resolving.de/urn:nbn:de:swb:ch1-200700845.

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Abstract:
Die Steigerung der Verarbeitungsleistung eingebetteter Mikroprozessoren gewinnt insbesondere durch zunehmende Bedeutung audiovisueller Datenverarbeitung in Verbindung mit drahtloser Kommunikation ständig an Bedeutung. Die notwendige Performance ist jedoch durch Anwendung klassischer Techniken des Prozessorentwurfs (Pipelining, Superskalarität) nur teilweise erreichbar. In unserem Beitrag möchten wir aufzeigen, daß die erforderliche Verarbeitungsleistung durch den Einsatz dynamisch rekonfigurierbarer Datenpfade bei gleichzeitig erhöhtem Flexibilitätsgrad erreicht werden kann. Anhand von quantitativen Untersuchungen zu Chipflächen und Leistungsbedarf einer 0,18µm CMOS-Standardzellenrealisierung der ARRIVE Architektur- Fallstudie wird ersichtlich, daß durch Einsatz eines einfachen RISC Mikroprozessors erweitert um einen rekonfigurierbaren DSP-Datenpfad eine gute Ausnutzung der vorhandenen Applikationsparallelität verbunden mit einem deutlichem Performancegewinn bei gleichzeitig geringem Chipflächen- und Leistungsbedarf erreichbar ist. Als Quelle des ermittelten und dargestellten Leistungsbedarfs dient dabei eine basierend auf repräsentativen DSP Benchmark-Algorithmen durchgeführte Power-Simulation des Chip-Layouts.
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Vießmann, Alexander [Verfasser]. "Implementierungsstrategien für rekonfigurierbare kognitive Funkempfänger / Alexander Vießmann." München : Verlag Dr. Hut, 2013. http://d-nb.info/103728724X/34.

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Bitterling, Johannes. "Entwurf rekonfigurierbarer Systemarchitekturen für mobile Roboter." [S.l. : s.n.], 2005. http://deposit.ddb.de/cgi-bin/dokserv?idn=974050547.

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Kalte, Heiko. "Einbettung dynamisch rekonfigurierbarer Hardwarearchitekturen in eine Universalprozessorumgebung /." Paderborn : Heinz-Nixdorf-Inst, 2004. http://bvbr.bib-bvb.de:8991/F?func=service&doc_library=BVB01&doc_number=013011064&line_number=0001&func_code=DB_RECORDS&service_type=MEDIA.

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Pivit, Florian. "Multiband-Aperturantennen für Basisstationsanwendungen in rekonfigurierbaren Mobilfunksystemen /." Karlsruhe : IHE, 2005. http://bvbr.bib-bvb.de:8991/F?func=service&doc_library=BVB01&doc_number=014885402&line_number=0001&func_code=DB_RECORDS&service_type=MEDIA.

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Lange, Hendrik [Verfasser]. "Modellbasierte Effizienzanalyse grobgranularer rekonfigurierbarer Prozessorarchitekturen / Hendrik Lange." Aachen : Shaker, 2008. http://d-nb.info/1164341324/34.

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Meisel, Andre. "Design Flow für IP basierte, dynamisch rekonfigurierbare, eingebettete Systeme." Doctoral thesis, Universitätsbibliothek Chemnitz, 2010. http://nbn-resolving.de/urn:nbn:de:bsz:ch1-201000890.

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Abstract:
Der achte Band der wissenschaftlichen Schriftenreihe EINGEBETTETE, SELBSTORGANISIERENDE SYSTEME widmet sich der Synthese von partiell dynamisch rekonfigurierbaren, eingebetteten Systemen. Mit der Möglichkeit Hardwareblöcke zur Laufzeit auf programmierbaren Bausteinen neu zu konfigurieren, lässt sich eine höhere Flexibilität im Vergleich zu einer Hardwarerealisierung in eingebettete Systeme integrieren. Gleichzeitig sind diese Systeme durch eine gesteigerte Performance gegenüber Software gekennzeichnet. Die Flexibilität kann ausgenutzt werden, um kleinere Schaltkreise bei gleichem Funktionsumfang einzusetzen. Für die Integration von Rekonfigurierung sind zusätzliche Entwurfschritte im Design Flow notwendig. Herr Meisel stellt hierfür in seiner Arbeit eine Entwurfsmethodik vor und geht im Besonderen auf die Partitionierung, Platzierung und Steuerung in dynamisch rekonfigurierbaren, eingebetteten Systemen ein. Um eine vergleichsweise effizient zu realisierende Partitionierung des Systems zu erhalten, wurde das Overlaying Verfahren aus dem Bereich der Speicherverwaltung für dynamische Rekonfigurierung adaptiert. Für das Platzierungsverfahren wurden Rekonfigurierungen als Markov Kette modelliert, um so zu einer Minimierung der durchschnittlichen Rekonfigurierungsdauer zu gelangen. Die vorgestellte Rekonfigurierungssteuerung fokussiert auf einer ressourcensparenden Hardware Implementierung. Mit einem Entwurfsbeispiel werden die Vorteile und Ergebnisse des Ansatzes anschaulich illustriert. So kann der Leser die Mächtigkeit des entwickelten Ansatzes nachvollziehen und wird motiviert, die entwickelte Methodik auf weitere Anwendungsfälle zu übertragen
Volume 8 of scientific series EINGEBETTETE, SELBSTORGANISIERENDE SYSTEME (Embedded Self-Organized Systems) addresses the synthesis of partially dynamically reconfigurable embedded systems. With the ability to configure hardware blocks during run-time, more flexibility can be integrated in embedded systems. At the same time, these systems have better performance than functions implemented in software. Through this flexibility it is possible to use smaller circuits without limiting the functionality. For the integration of reconfiguration into embedded systems, additional design steps are required. Mr. Meisel presents a design methodology for the design flow and primarily concerns the problem of partitioning, placement, and reconfiguration control in dynamically reconfigurable embedded systems. The implemented partitioning of the system is based on the adapted memory management concept of Overlaying. For the placement method the configurations are modeled as Markov chain, in order to minimize the average reconfiguration time. The presented reconfiguration control unit focuses on a resource-saving hardware implementation. The benefits and results of the approach are clearly illustrated with a design sample. The reader can understand the power of developed approach and is motivated to transfer the developed methodology to more use cases
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Meisel, André. "Design Flow für IP basierte, dynamisch rekonfigurierbare, eingebettete Systeme." Universitätsverlag Chemnitz, 2010. https://monarch.qucosa.de/id/qucosa%3A19340.

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Abstract:
Der achte Band der wissenschaftlichen Schriftenreihe EINGEBETTETE, SELBSTORGANISIERENDE SYSTEME widmet sich der Synthese von partiell dynamisch rekonfigurierbaren, eingebetteten Systemen. Mit der Möglichkeit Hardwareblöcke zur Laufzeit auf programmierbaren Bausteinen neu zu konfigurieren, lässt sich eine höhere Flexibilität im Vergleich zu einer Hardwarerealisierung in eingebettete Systeme integrieren. Gleichzeitig sind diese Systeme durch eine gesteigerte Performance gegenüber Software gekennzeichnet. Die Flexibilität kann ausgenutzt werden, um kleinere Schaltkreise bei gleichem Funktionsumfang einzusetzen. Für die Integration von Rekonfigurierung sind zusätzliche Entwurfschritte im Design Flow notwendig. Herr Meisel stellt hierfür in seiner Arbeit eine Entwurfsmethodik vor und geht im Besonderen auf die Partitionierung, Platzierung und Steuerung in dynamisch rekonfigurierbaren, eingebetteten Systemen ein. Um eine vergleichsweise effizient zu realisierende Partitionierung des Systems zu erhalten, wurde das Overlaying Verfahren aus dem Bereich der Speicherverwaltung für dynamische Rekonfigurierung adaptiert. Für das Platzierungsverfahren wurden Rekonfigurierungen als Markov Kette modelliert, um so zu einer Minimierung der durchschnittlichen Rekonfigurierungsdauer zu gelangen. Die vorgestellte Rekonfigurierungssteuerung fokussiert auf einer ressourcensparenden Hardware Implementierung. Mit einem Entwurfsbeispiel werden die Vorteile und Ergebnisse des Ansatzes anschaulich illustriert. So kann der Leser die Mächtigkeit des entwickelten Ansatzes nachvollziehen und wird motiviert, die entwickelte Methodik auf weitere Anwendungsfälle zu übertragen.
Volume 8 of scientific series EINGEBETTETE, SELBSTORGANISIERENDE SYSTEME (Embedded Self-Organized Systems) addresses the synthesis of partially dynamically reconfigurable embedded systems. With the ability to configure hardware blocks during run-time, more flexibility can be integrated in embedded systems. At the same time, these systems have better performance than functions implemented in software. Through this flexibility it is possible to use smaller circuits without limiting the functionality. For the integration of reconfiguration into embedded systems, additional design steps are required. Mr. Meisel presents a design methodology for the design flow and primarily concerns the problem of partitioning, placement, and reconfiguration control in dynamically reconfigurable embedded systems. The implemented partitioning of the system is based on the adapted memory management concept of Overlaying. For the placement method the configurations are modeled as Markov chain, in order to minimize the average reconfiguration time. The presented reconfiguration control unit focuses on a resource-saving hardware implementation. The benefits and results of the approach are clearly illustrated with a design sample. The reader can understand the power of developed approach and is motivated to transfer the developed methodology to more use cases.
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Braam, Reinhold. "Ein dynamisch rekonfigurierbares Multiprozessorsystem mit einem verteilten Verbindungsnetzwerk /." Düsseldorf : VDI-Verl, 1992. http://bvbr.bib-bvb.de:8991/F?func=service&doc_library=BVB01&doc_number=003102140&line_number=0001&func_code=DB_RECORDS&service_type=MEDIA.

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Otte, Marius [Verfasser]. "Matrixbasierte Signalverarbeitung auf rekonfigurierbaren CORDIC-Architekturen / Marius Otte." Aachen : Shaker, 2004. http://d-nb.info/1186574909/34.

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Wörn, Arno. "Ein Beitrag zur Gestaltung mechanischer Modulschnittstellen für rekonfigurierbare Mehrtechnologie-Werkzeugmaschinen /." Aachen : Shaker, 2009. http://d-nb.info/996643532/04.

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Kircher, Christian [Verfasser], and Alexander [Akademischer Betreuer] Verl. "Selbstadaptierende NC-Steuerung für rekonfigurierbare Werkzeugmaschinen / Christian Kircher. Betreuer: Alexander Verl." Stuttgart : Universitätsbibliothek der Universität Stuttgart, 2011. http://d-nb.info/1015681751/34.

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Kocks, Christian [Verfasser]. "Konzeption, Implementierung und Analyse eines rekonfigurierbaren Funkempfängers / Christian Kocks." München : Verlag Dr. Hut, 2013. http://d-nb.info/104230792X/34.

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Lienhart, Gerhard. "Beschleunigung hydrodynamischer astrophysikalischer Simulationen mit FPGA-basierten rekonfigurierbaren Koprozessoren." [S.l. : s.n.], 2004. http://deposit.ddb.de/cgi-bin/dokserv?idn=972136614.

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Bürdek, Johannes [Verfasser], Andy [Akademischer Betreuer] Schürr, and Ina [Akademischer Betreuer] Schaefer. "Rekonfigurierbare Software-Systeme: Spezifikation und Testfallgenerierung / Johannes Bürdek ; Andy Schürr, Ina Schaefer." Darmstadt : Universitäts- und Landesbibliothek Darmstadt, 2018. http://d-nb.info/1173899138/34.

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Wörn, Arno [Verfasser]. "Ein Beitrag zur Gestaltung mechanischer Modulschnittstellen für rekonfigurierbare Mehrtechnologie-Werkzeugmaschinen / Arno Wörn." Aachen : Shaker, 2009. http://d-nb.info/1159834903/34.

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Lepich, Thomas D. [Verfasser]. "Modellierung und Untersuchung von Rahmenstrukturen für rekonfigurierbare multimodale Simulationsumgebungen / Thomas D. Lepich." München : Verlag Dr. Hut, 2018. http://d-nb.info/116429377X/34.

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Schuster, Christian [Verfasser], Rolf [Akademischer Betreuer] Jakoby, and Wolfgang [Akademischer Betreuer] Heinrich. "Rekonfigurierbare Filternetzwerke für frequenzabstimmbare digitale Leistungsverstärker / Christian Schuster ; Rolf Jakoby, Wolfgang Heinrich." Darmstadt : Universitäts- und Landesbibliothek, 2021. http://d-nb.info/1226288901/34.

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Köster, Markus. "Analyse und Entwurf von Methoden zur Ressourcenverwaltung partiell rekonfigurierbarer Architekturen." [S.l.] : [s.n.], 2007. http://deposit.ddb.de/cgi-bin/dokserv?idn=98471541X.

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Brückner, Uwe [Verfasser]. "Entwurf und simulationsgestützte Analyse eines mechanisch rekonfigurierbaren Mehrmotorengetriebes / Uwe Brückner." Aachen : Shaker, 2018. http://d-nb.info/1188550608/34.

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Winkler, Lutz [Verfasser]. "Grundlagen zur Steuerung mobiler, modularer, selbst-rekonfigurierbarer Roboter / Lutz Winkler." München : Verlag Dr. Hut, 2015. http://d-nb.info/1071513060/34.

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Richly, Sebastian [Verfasser], Uwe [Akademischer Betreuer] Aßmann, and Rainer [Akademischer Betreuer] Schmidt. "Autonom rekonfigurierbare Workflows / Sebastian Richly. Gutachter: Uwe Aßmann ; Rainer Schmidt. Betreuer: Uwe Aßmann." Dresden : Saechsische Landesbibliothek- Staats- und Universitaetsbibliothek Dresden, 2012. http://d-nb.info/1068443316/34.

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Vette-Steinkamp, Matthias [Verfasser]. "Rekonfigurierbares Robotersystem für die Montage von flächigen Flugzeugstrukturbauteilen / Matthias Vette-Steinkamp." Aachen : Shaker, 2018. http://d-nb.info/1162794194/34.

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Meisel, André [Verfasser]. "Design Flow für IP basierte, dynamisch rekonfigurierbare, eingebettete Systeme / André Meisel. Technische Universität Chemnitz." Chemnitz : Univ.-Verl, 2010. http://d-nb.info/1007651849/34.

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Hinkelmann, Heiko [Verfasser]. "Entwurf und Energieeffizienzanalyse von dynamisch rekonfigurierbaren Architekturen für drahtlose Sensorknoten / Heiko Hinkelmann." München : Verlag Dr. Hut, 2012. http://d-nb.info/1021072702/34.

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Eisenhardt, Sven [Verfasser]. "Vorausschauende Rekonfiguration dynamisch rekonfigurierbarer Prozessoren in einem System on Chip / Sven Eisenhardt." München : Verlag Dr. Hut, 2013. http://d-nb.info/1031843736/34.

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Albrecht, Carsten. "Modellierung und Simulation dynamisch rekonfigurierbarer Architekturen am Beispiel eines laufzeitadaptiven Netzwerk-Coprozessors." Berlin Logos, 2009. http://d-nb.info/1001251334/04.

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Nowak, Fabian [Verfasser]. "Methoden und Werkzeuge zum Einsatz von rekonfigurierbaren Akzeleratoren in Mehrkernsystemen / Fabian Nowak." Karlsruhe : KIT-Bibliothek, 2015. http://d-nb.info/107320488X/34.

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Schlachter, Florian [Verfasser]. "Verteilte online und onboard Evolution und Adaption von Kontrollmechanismen für rekonfigurierbare modulare Roboter / Florian Schlachter." Aachen : Shaker, 2014. http://d-nb.info/1066197075/34.

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Tschakarow, Roland K. [Verfasser]. "Entwurf, Auslegung und Umsetzung eines Systems neuartiger Gelenkmodule für rekonfigurierbare Leichtbau-Gelenkarmroboter / Roland K Tschakarow." Aachen : Shaker, 2010. http://d-nb.info/110683870X/34.

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Bischof, Simon [Verfasser], and M. [Akademischer Betreuer] Weber. "Rekonfigurierbare Lithium-Ionen-Batterien für den Betrieb von industriellen Produktionsstätten / Simon Bischof ; Betreuer: M. Weber." Karlsruhe : KIT-Bibliothek, 2020. http://d-nb.info/1223985997/34.

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Pionteck, Thilo [Verfasser]. "Dynamisch rekonfigurierbare Architekturen für das digitale Basisband und für die Sicherungsschicht drahtloser Netzwerke / Thilo Pionteck." Aachen : Shaker, 2005. http://d-nb.info/1186581891/34.

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Mühlbauer, Felix. "Entwurf, Methoden und Werkzeuge für komplexe Bildverarbeitungssysteme auf Rekonfigurierbaren System-on-Chip-Architekturen." Phd thesis, Universität Potsdam, 2011. http://opus.kobv.de/ubp/volltexte/2012/5992/.

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Abstract:
Bildverarbeitungsanwendungen stellen besondere Ansprüche an das ausführende Rechensystem. Einerseits ist eine hohe Rechenleistung erforderlich. Andererseits ist eine hohe Flexibilität von Vorteil, da die Entwicklung tendentiell ein experimenteller und interaktiver Prozess ist. Für neue Anwendungen tendieren Entwickler dazu, eine Rechenarchitektur zu wählen, die sie gut kennen, anstatt eine Architektur einzusetzen, die am besten zur Anwendung passt. Bildverarbeitungsalgorithmen sind inhärent parallel, doch herkömmliche bildverarbeitende eingebettete Systeme basieren meist auf sequentiell arbeitenden Prozessoren. Im Gegensatz zu dieser "Unstimmigkeit" können hocheffiziente Systeme aus einer gezielten Synergie aus Software- und Hardwarekomponenten aufgebaut werden. Die Konstruktion solcher System ist jedoch komplex und viele Lösungen, wie zum Beispiel grobgranulare Architekturen oder anwendungsspezifische Programmiersprachen, sind oft zu akademisch für einen Einsatz in der Wirtschaft. Die vorliegende Arbeit soll ein Beitrag dazu leisten, die Komplexität von Hardware-Software-Systemen zu reduzieren und damit die Entwicklung hochperformanter on-Chip-Systeme im Bereich Bildverarbeitung zu vereinfachen und wirtschaftlicher zu machen. Dabei wurde Wert darauf gelegt, den Aufwand für Einarbeitung, Entwicklung als auch Erweiterungen gering zu halten. Es wurde ein Entwurfsfluss konzipiert und umgesetzt, welcher es dem Softwareentwickler ermöglicht, Berechnungen durch Hardwarekomponenten zu beschleunigen und das zu Grunde liegende eingebettete System komplett zu prototypisieren. Hierbei werden komplexe Bildverarbeitungsanwendungen betrachtet, welche ein Betriebssystem erfordern, wie zum Beispiel verteilte Kamerasensornetzwerke. Die eingesetzte Software basiert auf Linux und der Bildverarbeitungsbibliothek OpenCV. Die Verteilung der Berechnungen auf Software- und Hardwarekomponenten und die daraus resultierende Ablaufplanung und Generierung der Rechenarchitektur erfolgt automatisch. Mittels einer auf der Antwortmengenprogrammierung basierten Entwurfsraumexploration ergeben sich Vorteile bei der Modellierung und Erweiterung. Die Systemsoftware wird mit OpenEmbedded/Bitbake synthetisiert und die erzeugten on-Chip-Architekturen auf FPGAs realisiert.
Image processing applications have special requirements to the executing computational system. On the one hand a high computational power is necessary. On the other hand a high flexibility is an advantage because the development tends to be an experimental and interactive process. For new applications the developer tend to choose a computational architecture which they know well instead of using that one which fits best to the application. Image processing algorithms are inherently parallel while common image processing systems are mostly based on sequentially operating processors. In contrast to this "mismatch", highly efficient systems can be setup of a directed synergy of software and hardware components. However, the construction of such systems is complex and lots of solutions, like gross-grained architectures or application specific programming languages, are often too academic for the usage in commerce. The present work should contribute to reduce the complexity of hardware-software-systems and thus increase the economy of and simplify the development of high-performance on-chip systems in the domain of image processing. In doing so, a value was set on keeping the effort low on making familiar to the topic, on development and also extensions. A design flow was developed and implemented which allows the software developer to accelerate calculations with hardware components and to prototype the whole embedded system. Here complex image processing systems, like distributed camera sensor networks, are examined which need an operating system. The used software is based upon Linux and the image processing library OpenCV. The distribution of the calculations to software and hardware components and the resulting scheduling and generation of architectures is done automatically. The design space exploration is based on answer set programming which involves advantages for modelling in terms of simplicity and extensions. The software is synthesized with the help of OpenEmbedded/Bitbake and the generated on-chip architectures are implemented on FPGAs.
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Abel, Michael [Verfasser], and Peter [Akademischer Betreuer] Klemm. "Automatisierte Inbetriebnahme von rekonfigurierbaren Bearbeitungsmaschinen mit serviceorientierten Paradigmen / Michael Abel ; Betreuer: Peter Klemm." Stuttgart : Universitätsbibliothek der Universität Stuttgart, 2017. http://d-nb.info/1128646579/34.

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Thomas, Alexander [Verfasser], and J. [Akademischer Betreuer] Becker. "Dynamisch und partiell rekonfigurierbare Hardwarearchitektur mit adaptivem hardwaregestützten Routing zur Laufzeit / Alexander Thomas. Betreuer: J. Becker." Karlsruhe : KIT-Bibliothek, 2015. http://d-nb.info/1097380882/34.

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Knodel, Oliver [Verfasser], Rainer G. [Akademischer Betreuer] Spallek, and Mario [Gutachter] Schölzel. "Rekonfigurierbare Hardwarekomponenten im Kontext von Cloud-Architekturen / Oliver Knodel ; Gutachter: Mario Schölzel ; Betreuer: Rainer G. Spallek." Dresden : Saechsische Landesbibliothek- Staats- und Universitaetsbibliothek Dresden, 2018. http://d-nb.info/1226811388/34.

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Hees, Andreas Fabian [Verfasser], Gunther [Akademischer Betreuer] [Gutachter] Reinhart, and Thomas [Gutachter] Bauernhansl. "System zur Produktionsplanung für rekonfigurierbare Produktionssysteme / Andreas Fabian Hees ; Gutachter: Thomas Bauernhansl, Gunther Reinhart ; Betreuer: Gunther Reinhart." München : Universitätsbibliothek der TU München, 2017. http://d-nb.info/1134865872/34.

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Hees, Andreas Fabian [Verfasser], Gunther [Akademischer Betreuer] Reinhart, and Thomas [Gutachter] Bauernhansl. "System zur Produktionsplanung für rekonfigurierbare Produktionssysteme / Andreas Fabian Hees ; Gutachter: Thomas Bauernhansl, Gunther Reinhart ; Betreuer: Gunther Reinhart." München : Universitätsbibliothek der TU München, 2017. http://nbn-resolving.de/urn:nbn:de:bvb:91-diss-20170516-1335667-1-1.

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Mühlbauer, Felix [Verfasser], and Christophe [Akademischer Betreuer] Bobda. "Entwurf, Methoden und Werkzeuge für komplexe Bildverarbeitungssysteme auf Rekonfigurierbaren System-on-Chip-Architekturen / Felix Mühlbauer. Betreuer: Christophe Bobda." Potsdam : Universitätsbibliothek der Universität Potsdam, 2012. http://d-nb.info/1023802899/34.

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Kriesten, Daniel. "Systementwurf eingebetteter heterogener rekonfigurierbarer Systeme mit Linux-Betriebssystem am Beispiel einer modularen Plattform zur Erfassung und Verarbeitung von Sensordaten." Doctoral thesis, Universitätsbibliothek Chemnitz, 2015. http://nbn-resolving.de/urn:nbn:de:bsz:ch1-qucosa-154966.

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Abstract:
Ausgehend von einer modularen Plattform zur Erfassung und Verarbeitung von Sensordaten bereichert die vorliegende Dissertationsschrift den Systementwurf eingebetteter Systeme um neue Facetten. Ihr besonderer Fokus liegt dabei auf rekonfigurierbaren Architekturen und Linux-basierten Systemen. Ein wesentlicher Beitrag ist die Darstellung und Diskussion von Konzepten und Architekturen vorgenannter Systeme durch ihre Betrachtung auf einer hohen Abstraktionsebene. Dazu schafft die Arbeit ein umfassendes Verständnis für Kommunikation und Konfiguration in heterogenen rekonfigurierbaren Systemen und überträgt die Erkenntnisse auf das Linux-Betriebssystem. Es erfolgt außerdem eine systematische Darstellung der etablierten Zusammenhänge und Abläufe beim Software-, Paket- und Versionsmanagement im Linux-Umfeld. Zur Verbesserung des Entwurfsflusses werden Konzepte und ein geeignetes Werkzeug zur High-Level Spezifikation von Linux-Systemen dargestellt. Die in der Arbeit gewonnenen wissenschaftlichen Erkenntnisse werden hinsichtlich praktischer Relevanz evaluiert und durch prototypische Implementierungen verifiziert
Based on a modular platform for recording and processing of sensor data the present thesis enriches the field of system design of embedded systems with new facets. Its particular focus is on reconfigurable architectures and Linux-based systems. A major contribution is the presentation and discussion of concepts and architectures of aforementioned systems by investigating them on a high level of abstraction. To achieve this, the work creates a comprehensive understanding of communication and configuration in heterogeneous reconfigurable systems. This knowledge is transferred on the Linux operating system. In addition, a systematic presentation of the established relationships and processes in software, package and version management in the Linux environment takes place. To improve the design flow of Linux systems, the thesis presents appropriate concepts as well as a tool for high-level specification of embedded Linux systems. The gained scientific findings are evaluated in terms of practical relevance and verified by prototype implementations
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Kriesten, Daniel. "Systementwurf eingebetteter heterogener rekonfigurierbarer Systeme mit Linux-Betriebssystem am Beispiel einer modularen Plattform zur Erfassung und Verarbeitung von Sensordaten." Doctoral thesis, Universitätsverlag der Technischen Universität Chemnitz, 2013. https://monarch.qucosa.de/id/qucosa%3A20141.

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Abstract:
Ausgehend von einer modularen Plattform zur Erfassung und Verarbeitung von Sensordaten bereichert die vorliegende Dissertationsschrift den Systementwurf eingebetteter Systeme um neue Facetten. Ihr besonderer Fokus liegt dabei auf rekonfigurierbaren Architekturen und Linux-basierten Systemen. Ein wesentlicher Beitrag ist die Darstellung und Diskussion von Konzepten und Architekturen vorgenannter Systeme durch ihre Betrachtung auf einer hohen Abstraktionsebene. Dazu schafft die Arbeit ein umfassendes Verständnis für Kommunikation und Konfiguration in heterogenen rekonfigurierbaren Systemen und überträgt die Erkenntnisse auf das Linux-Betriebssystem. Es erfolgt außerdem eine systematische Darstellung der etablierten Zusammenhänge und Abläufe beim Software-, Paket- und Versionsmanagement im Linux-Umfeld. Zur Verbesserung des Entwurfsflusses werden Konzepte und ein geeignetes Werkzeug zur High-Level Spezifikation von Linux-Systemen dargestellt. Die in der Arbeit gewonnenen wissenschaftlichen Erkenntnisse werden hinsichtlich praktischer Relevanz evaluiert und durch prototypische Implementierungen verifiziert.
Based on a modular platform for recording and processing of sensor data the present thesis enriches the field of system design of embedded systems with new facets. Its particular focus is on reconfigurable architectures and Linux-based systems. A major contribution is the presentation and discussion of concepts and architectures of aforementioned systems by investigating them on a high level of abstraction. To achieve this, the work creates a comprehensive understanding of communication and configuration in heterogeneous reconfigurable systems. This knowledge is transferred on the Linux operating system. In addition, a systematic presentation of the established relationships and processes in software, package and version management in the Linux environment takes place. To improve the design flow of Linux systems, the thesis presents appropriate concepts as well as a tool for high-level specification of embedded Linux systems. The gained scientific findings are evaluated in terms of practical relevance and verified by prototype implementations.
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Müller, Marcus [Verfasser], Wolfgang [Akademischer Betreuer] Fengler, Christoph [Gutachter] Ament, and Volker [Gutachter] Zerbe. "Beitrag zum modellbasierten Entwurf eingebetteter Systeme - Komponentenbasierte Modellierungsansätze für verteilte rekonfigurierbare Plattformen / Marcus Müller ; Gutachter: Christoph Ament, Volker Zerbe ; Betreuer: Wolfgang Fengler." Ilmenau : TU Ilmenau, 2014. http://d-nb.info/1178182606/34.

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Heinzig, André [Verfasser], Thomas [Akademischer Betreuer] Mikolajick, Walter M. [Akademischer Betreuer] Weber, and Franz [Akademischer Betreuer] Kreupl. "Entwicklung und Herstellung rekonfigurierbarer Nanodraht-Transistoren und Schaltungen / André Heinzig. Betreuer: Thomas Mikolajick ; Walter M. Weber. Gutachter: Thomas Mikolajick ; Franz Kreupl." Dresden : Saechsische Landesbibliothek- Staats- und Universitaetsbibliothek Dresden, 2016. http://d-nb.info/110035607X/34.

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Freier, Robert [Verfasser], and Andreas [Akademischer Betreuer] König. "Ein universelles und dynamisch rekonfigurierbares Interface für eingebettete und intelligente Multi-Sensor-Systeme mit Self-x Eigenschaften / Robert Freier. Betreuer: Andreas König." Kaiserslautern : Technische Universität Kaiserslautern, 2015. http://d-nb.info/1065233191/34.

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Freier, Robert Klemens [Verfasser], and Andreas [Akademischer Betreuer] König. "Ein universelles und dynamisch rekonfigurierbares Interface für eingebettete und intelligente Multi-Sensor-Systeme mit Self-x Eigenschaften / Robert Freier. Betreuer: Andreas König." Kaiserslautern : Technische Universität Kaiserslautern, 2015. http://nbn-resolving.de/urn:nbn:de:hbz:386-kluedo-39669.

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Genßler, Paul R. "Virtualized Reconfigurable Resources and Their Secured Provision in an Untrusted Cloud Environment." Master's thesis, Saechsische Landesbibliothek- Staats- und Universitaetsbibliothek Dresden, 2018. http://nbn-resolving.de/urn:nbn:de:bsz:14-qucosa-231445.

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Abstract:
The cloud computing business grows year after year. To keep up with increasing demand and to offer more services, data center providers are always searching for novel architectures. One of them are FPGAs, reconfigurable hardware with high compute power and energy efficiency. But some clients cannot make use of the remote processing capabilities. Not every involved party is trustworthy and the complex management software has potential security flaws. Hence, clients’ sensitive data or algorithms cannot be sufficiently protected. In this thesis state-of-the-art hardware, cloud and security concepts are analyzed and com- bined. On one side are reconfigurable virtual FPGAs. They are a flexible resource and fulfill the cloud characteristics at the price of security. But on the other side is a strong requirement for said security. To provide it, an immutable controller is embedded enabling a direct, confidential and secure transfer of clients’ configurations. This establishes a trustworthy compute space inside an untrusted cloud environment. Clients can securely transfer their sensitive data and algorithms without involving vulnerable software or a data center provider. This concept is implemented as a prototype. Based on it, necessary changes to current FPGAs are analyzed. To fully enable reconfigurable yet secure hardware in the cloud, a new hybrid architecture is required
Das Geschäft mit dem Cloud Computing wächst Jahr für Jahr. Um mit der steigenden Nachfrage mitzuhalten und neue Angebote zu bieten, sind Betreiber von Rechenzentren immer auf der Suche nach neuen Architekturen. Eine davon sind FPGAs, rekonfigurierbare Hardware mit hoher Rechenleistung und Energieeffizienz. Aber manche Kunden können die ausgelagerten Rechenkapazitäten nicht nutzen. Nicht alle Beteiligten sind vertrauenswürdig und die komplexe Verwaltungssoftware ist anfällig für Sicherheitslücken. Daher können die sensiblen Daten dieser Kunden nicht ausreichend geschützt werden. In dieser Arbeit werden modernste Hardware, Cloud und Sicherheitskonzept analysiert und kombiniert. Auf der einen Seite sind virtuelle FPGAs. Sie sind eine flexible Ressource und haben Cloud Charakteristiken zum Preis der Sicherheit. Aber auf der anderen Seite steht ein hohes Sicherheitsbedürfnis. Um dieses zu bieten ist ein unveränderlicher Controller eingebettet und ermöglicht eine direkte, vertrauliche und sichere Übertragung der Konfigurationen der Kunden. Das etabliert eine vertrauenswürdige Rechenumgebung in einer nicht vertrauenswürdigen Cloud Umgebung. Kunden können sicher ihre sensiblen Daten und Algorithmen übertragen ohne verwundbare Software zu nutzen oder den Betreiber des Rechenzentrums einzubeziehen. Dieses Konzept ist als Prototyp implementiert. Darauf basierend werden nötige Änderungen von modernen FPGAs analysiert. Um in vollem Umfang eine rekonfigurierbare aber dennoch sichere Hardware in der Cloud zu ermöglichen, wird eine neue hybride Architektur benötigt
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